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| GIM>Investigación>Publicaciones |
| PUBLICACIONES en las que participa: "Pablo Pedro Sánchez" ordenadas por línea de investigación |
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| Diseño de circuitos electrónicos de aplicación industrial |
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Jesús Miguel Pérez, Pablo Pedro Sánchez
"Real-Time Stereo Matching using memory-efficient Belief Propagation for High-definition 3D tele-presence systems"
Iberoamerican Congress on Pattern Recognition (CIARP-2009). Guadalajara, Mexico. 2009-11 |
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| Diseño y verificación de sistemas electrónicos para comunicaciones |
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Jesús Miguel Pérez, Pablo Pedro Sánchez, Víctor Fernández
"FGPA Implementation of a MAP Decoder for DVB-S Satellite Reception"
XVIII Conference on Design of Circuits and Integrated Systems (DCIS2003). Ciudad Real. 2003-11 |
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Jesús Miguel Pérez, Pablo Pedro Sánchez
"FPGA implementation of DVB-RCS turbo coder and decoder"
Proceedings of the XVII Design of Circuits and Integrated Systems Conference, Servicio de Publicaciones de la Universidad de Cantabria. 2002-11 |
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L. Chen, S. Dey, Pablo Pedro Sánchez, K. Sekar, Y.H. Chen
"Embedded Hardware and Software Self-Testing Methodologies for Processor Cores"
37th Design Automation Conference, Los Angeles, California. 2000-06 |
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Eugenio Villar, Pablo Pedro Sánchez
"Síntesis"
VHDL: Lenguaje estándar de diseño electrónico
McGraw-Hill. 1998-01 |
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J. L. Barreda, Pablo Pedro Sánchez
"Current fault modeling in VITAL"
XI Conference Design of Integrated Circuits and Systems (DCIS´96). Sitges (Barcelona).. 1996-11 |
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J. L. Barreda, Pablo Pedro Sánchez
"Current modeling in VITAL"
ATW Workshop. 1996-06 |
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J. L. Barreda, I. Hidalgo, Víctor Fernández, Pablo Pedro Sánchez, Eugenio Villar
"Fault Modeling in VITAL"
Proceedings of the Workshop on Libraries, Component Modeling, and Quality Assurance. Nantes, France. 1995-04 |
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| Métodos de test de circuitos integrados digitales y mixtos |
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I. Hidalgo, Pablo Pedro Sánchez
"System Level Fault Simulation"
BELSIGN Workshop. Corcega. 1996-04 |
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J. L. Barreda, Pablo Pedro Sánchez, Eugenio Villar
"Current fault modeling in VITAL"
VHDL International User´s Forum. Santa Clara, CA, USA. 1996-02 |
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I. Hidalgo, Pablo Pedro Sánchez
"Técnica para simulación de fallos en un entorno VHDL"
Congreso de Diseño de Circuitos Integrados y Sistemas (DCIS95). Zaragoza. 1995-11 |
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Víctor Fernández, Pablo Pedro Sánchez
"Síntesis de alto nivel para scan parcial"
Actas del Congreso de Diseño de Circuitos Integrados y Sistemas. Zaragoza. 1995-11 |
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| Diseño y verificación de sistemas embebidos HW/SW |
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Álvaro Díaz, Eugenio Villar, Pablo Pedro Sánchez
"Integrated Framework for Reusable Multi-Level Embedded System Verification"
Work-in-Progress Session, DAC, San Francisco. 2018-06 |
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